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C8051F380/1/2/3/4/5/6/7/C
SFR Definition 17.2. RSTSRC: Reset Source
Bit
Name
Type
Reset
7
USBRSF
R/W
Varies
6
FERROR
R
Varies
5
C0RSEF
R/W
Varies
4
SWRSF
R/W
Varies
3
WDTRSF
R
Varies
2
MCDRSF
R/W
Varies
1
PORSF
R/W
Varies
0
PINRSF
R
Varies
SFR Address = 0xEF; SFR Page = All Pages
Bit
Name
Description
Write
Read
7
6
USBRSF USB Reset Flag
FERROR Flash Error Reset Flag.
Writing a 1 enables USB
as a reset source.
N/A
Set to 1 if USB caused the
last reset.
Set to 1 if Flash
read/write/erase error
caused the last reset.
5
C0RSEF Comparator0 Reset Enable
Writing a 1 enables Com-
Set to 1 if Comparator0
and Flag.
parator0 as a reset source caused the last reset.
(active-low).
4
SWRSF
Software Reset Force and
Flag.
Writing a 1 forces a sys-
tem reset.
Set to 1 if last reset was
caused by a write to
SWRSF.
3
WDTRSF Watchdog Timer Reset Flag. N/A
Set to 1 if Watchdog Timer
overflow caused the last
reset.
2
MCDRSF Missing Clock Detector
Enable and Flag.
Writing a 1 enables the
Missing Clock Detector.
The MCD triggers a reset
Set to 1 if Missing Clock
Detector timeout caused
the last reset.
if a missing clock condition
is detected.
source.
1
PORSF
Power-On / V DD Monitor Writing a 1 enables the
Reset Flag, and V DD monitor V DD monitor as a reset
Reset Enable.
Writing 1 to this bit
before the V DD monitor
is enabled and stabilized
Set to 1 anytime a power-
on or V DD monitor reset
occurs.
When set to 1 all other
RSTSRC flags are inde-
terminate.
may cause a system
reset.
0
PINRSF
HW Pin Reset Flag.
N/A
Set to 1 if RST pin caused
the last reset.
Note: Do not use read-modify-write operations on this register
134
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